Design

Einen Generationswechsel im EDA-Bereich kündigt Cadence mit seinem neuen EDA-Tool Joint Enterprise Data and AI (JedAI) an.
© Cadence

IC-Entwicklung

EDA-Tools mit KI-Unterstützung

Für die Entwicklung von ICs und SoCs hat Cadence zwei neue EDA-Tools entwickelt: die…

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Fahrzeug
© Adobe Stock

SiFive

RISC-V-Portfolio für Automotive-Anwendungen

SiFive hat drei IP-Cores auf Basis der RISC-V-ISA entwickelt, die auf…

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James-Webb-Weltraumteleskop
© EnSilica

Hohe Strahlung im Weltraum handhaben

Schaltungen für anspruchsvolle Umgebungen entwickeln

Die ionisierende Strahlung, der elektronische Bauelemente im Weltraum ausgesetzt sind,…

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Verifikationssoftware für Mixed-Signal-ICs: Symphony Pro
© Siemens

Verifikation von Mixed-Signal-ICs

Schneller mit digitalen Methoden

Bis zu zehnmal schneller arbeitet die neue Verifikationssoftware Symphony Pro für…

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ConnX 110 und ConnX 120 DSPs
© Cadence Design Systems

Kleiner und energiesparender

DSP-Cores für Automotive-, Consumer- und Industriemärkte

Cadence Design Systems hat seine Familie der Tensilica ConnX Radar-, Lidar- und…

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Conference Topic System-on-Chip Design
© WEKA Fachmedien

embedded world Conference briefing (7)

System-on-Chip Design

Was steht im Bereich System-on-Chip Design auf der embedded world Conference im Programm?

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Schmuckbild Umsatzsteigerung
© Monster Ztudio/stock.adobe.com

ARM

Rekordumsätze und -gewinne

Nach der geplatzten Nvidia-Übernahme: Im ersten Quartal des Finanzjahrs 2021 hat ARM einen…

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© xyz+ | stock.adobe.com

MIPS

Zwei RISC-V-Prozessorkerne

MIPS, das 2021 nach dem Insolvenzverfahren nach Chapter 11 von Wave Computing entstanden…

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Dank VR soll das Auto zukünftig zur Erlebnisplattform werden
© Audi AG

Netzverstärkung

Ey Mann, wo is' meine VR-Brille?

Airbus wettet weiter auf Wasserstoff, goldene Zeiten im Osten und Audi startet mit VR auf…

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RISC-V-Core
© Fraunhofer IPMS

Fraunhofer IPMS

RISC-V-Core für KI-Anwendungen im Edge

Im neusten Release hat das Fraunhofer IPMS eine Portierung von Tensorflow lite auf den…

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