Industrie 4.0 und IoT
Wege zur sicheren Datenkommunikation
7. Juli 2017, 9:00 Uhr |
Von Konrad Zöpf
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Fortsetzung des Artikels von Teil 3
Sicherheitsfunktionen der i.MX6UL-CPU
Die Tabelle zeigt als Beispiel die in der i.MX6UL CPU von NXP unterstützten Funktionen, die vom Anwender zur Realisierung eines sicheren Systems verwendet werden können.
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| Hardware cryptographic accelerators (CAAM) | Symmetric key authentication: • AES-128/256, with DPA protection • DES, 3DES • ARC4 Asymmetric authentication (public key) • RSA (up to 4096) • Elliptic curve digital signature algorithm, ECDSA (up to P-521) |
| Cryptograhic hash fuction | MD5, SHA-1, SHA-224, SHA-256 |
| Tamper detection & protection | • DryICE (On-chip voltage, temp, freq monitoring) • Dedicated tamper pins, 10 pins total (can be configured to be 10 passive or up to 5 active pairs) • Tamper logging |
| DRAM encryption | On-the-fly DRAM data encryption/decryption with AES-128 |
| Hardened readback disable | Yes, lock bit can disable the access of the key |
| DPA resistant | DPA protection for AES |
| Obfuscated key storage protection | On-chip zeroizable 8 × 4 KB Secure RAM Off-chip key/data blobs AES-256 master key (CAAM/SNVS) |
| Permanent JTAG disable | Yes – Secure JTAG Controller (with electrical fuses) |
| Internal key clearance | On-chip zeroizable 8 × 4 KB Secure RAM (32 KB) |
| Unique ID (Device DNA) | Yes, as the OTPMK secret, which is unique per part. The OTPMK cannot be directly read but can be uses to encrypt a constant to create a unique number, for use as a unique ID. Each chip has a 64 bit unique ID in OTP fuse. |
| Unique ID (User eFuse) | Yes – General purpose OTP fuse for customer use |
| Secure storage | Secure storage • Zero-able master key (256 bit) • General purpose 32 bit register • Secure high assurance boot • Up to 2 Kbit e-fuse |
| Permanent decryptor disable | Yes (export disable fuse – disable all crypto except hash engine and RNG) |
| Secure RAM w/ battery backup | Yes – 256 bit master key storage with Secure RTC (real-time clock) power (SNVS) |
| Additional security features | • Run-time integrity checker and security controller • Random number generator (NIST SP 800-90) • ARM TrustZone • 2 × EMV compatible SIM V2 & EMVSIM module |
Sicherheitsfunktionen der i.MX6UL-CPU.(Quelle: NXP)
- Wege zur sicheren Datenkommunikation
- Security baut auf Safety auf
- Security mit oder ohne Hardware-Beschleuniger
- Sicherheitsfunktionen der i.MX6UL-CPU
- Sicherheitsfaktor Betriebssystem
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