Design

T-Spice-Analog-Simulator um Verilog-A-Compiler erweitert

In seinem neuen Produkt HiPer-Simulation erweitert Tanner seinen T-Spice-Analog-Simulator um den Verilog-A-Compiler von Tiburon.

T-Spice-Analog-Simulator um Verilog-A-Compiler erweitert

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Äquivalenz-Checker für die Verifikation von der FPGA-Synthese aus

Der EDA-Spezialist OneSpin hat den 360-EC-FPGA-Äquivalenz-Checker vorgestellt, der alle…

Äquivalenz-Checker für die Verifikation von der FPGA-Synthese aus

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Neue Lösungen für die Open-Verification-Methodology

Cadence integriert eine Aspekt-orientierte Testgenerierungs-Engine und eine erweiterte…

Neue Lösungen für die Open-Verification-Methodology

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Programmer für NAND-Flash-ICs

Die neue Version des Flash-Memory-Programmers Flashstream von BPM-Microsystems reduziert…

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Verteilung der Simulink-Modell-Simulation auf Mehrprozessor-Systeme

MathWorks hat Tools zur Verteilung der Simulation von Simulink-Modellen auf…

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