ESD-Schutz für 2,5D-/3D-ICs

Der Schutz vor elektrostatischer Entladung – auch als ESD-Festigkeit bezeichnet – ist ein wichtiger Aspekt bei der IC-Entwicklung und -Verifikation, auch bei modernen 2,5D-/3D-ICs. Welche Konzepte sich hierfür anbieten, verrät Dina Medhat von Siemens Digital Industries Software im Interview.

Literatur

[1] ESD Technical Report for ESD Electronic Design Automation Checks.

EO S/ESD Association, TR 18.0-01-14, 2015,

www.esda.org/store/standards/product/4/esd-tr18-0-01-14.

[2] Lescot, J.; et al.: A comprehensive ESD verification flow at transistor

level for large SoC designs. 37th Electrical Overstress/Electrostatic

Discharge Symposium (EO S/ESD), 27.9.–2.10.2015, DO I: 10.1109/EO -

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[3] Electrostatic Discharge (ESD) in 3D-IC Packages. Global Semiconductor

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[4] Medhat, D.; Dessouky, M. und Khalil, D.: Electrostatic Discharge

Physical Verification of 2.5D/3D Integrated Circuits. 21st International

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[5] Medhat, D.; Dessouky, M. und Khalil, D.: A Programmable Checker

for Automated 2.5-D/3-D IC ESD Verification. IEEE Transactions on

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[6] Overview Calibre PER C, Siemens Digital Industries Software. Website

https://eda.sw.siemens.com/en-US/ic/calibre-design/reliabilityverification/

perc/.

1. ESD-Schutz für 2,5D-/3D-ICs
2. Gibt es eine eigene Methode zur automatisierten ESD-Verifizierung in 2,5D- und 3D-ICs?
3. Literatur

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